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每期人數限3到5人。

上課時間和地點

上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山學院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領館區1號（中和大道）【沈陽分部】：沈陽理工大學/六宅臻品【鄭州分部】：鄭州大學/錦華大廈【石家莊分部】：河北科技大學/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協同大廈
最近開課時間(周末班/連續班/晚班）：2020年3月16日

實驗設備

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質量保障

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后,授課老師留給學員聯系方式,保障培訓效果,免費提供課后技術支持。
        3、培訓合格學員可享受免費推薦就業機會。

課程大綱

基于Xilinx ISE 的FPAG/CPLD設計與應用培訓
? 基于Xilinx?ISE?的FPAG/CPLD設計與應用培訓
1、聚焦Xilinx?ISE
1.1??Xilinx公司及其產品介紹
1.2??FPGA/CPLD基本結構與實現原理
1.3??系統設計語言——VHDL基本概念與程序結構
1.4??HDL編碼風格及規則
1.5??ISE基本操作
2、基于VHDL語言的設計輸入
2.1??新建工程
2.2??手動新建源代碼
2.3??利用語言模板創建源代碼
3、設計仿真
3.1??仿真基本概念
3.2??創建測試基準波形文件
3.3??使用Modelsim進行仿真
4、基于原理圖與狀態機的輸入
4.1??原理圖設計概述
4.2??利用原理圖的設計方法
4.3??實例化計數器
4.4??狀態機輸入工具——StateCAD
5、綜合與設計實現
5.1??XST概述
5.2??設計實現
5.3??約束
5.4??IP?Core簡介
6、功耗分析與FPGA/CPLD配置
6.1??功耗評估工具——XPower
6.2??基于ISE的硬件編程
7、應用實例
7.1??VHDL數字邏輯電路設計試驗
7.2??實例
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